用Verilog编写的七人表决器代码，七人表决超过四人就通过的功能

文件列表：
├文件夹1：[work1]
│  ├(1)voter_7.cr.mti
│  ├(2)voter_7.mpf
│  ├(3)voter_7.vo
│  ├(4)voter_7_tb.v
│  ├(5)voter_7_tb.v.bak
│  ├(6)voter_7_v.sdo
│  ├(7)voter_7_v.sdo_typ.csd
│  ├(8)vsim.wlf
│  ├文件夹1：[work]
│  │  ├文件夹1：[voter_7]
│  │  │  ├(1)verilog.asm64
│  │  │  ├(2)verilog.rw64
│  │  │  ├(3)_primary.dat
│  │  │  ├(4)_primary.dbs
│  │  │  ├(5)_primary.vhd
│  │  │  └█
│  │  ├文件夹2：[voter_7_tb]
│  │  │  ├(1)verilog.asm64
│  │  │  ├(2)verilog.rw64
│  │  │  ├(3)_primary.dat
│  │  │  ├(4)_primary.dbs
│  │  │  ├(5)_primary.vhd
│  │  │  └█
│  │  ├(1)_info
│  │  ├文件夹3：[_temp]
│  │  │  └█
│  │  ├(2)_vmake
│  │  └█
│  └█
└█

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2024-2-9 04:30 上传

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